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更新于 10月17日

FPGA邏輯設(shè)計(jì)師

2-4萬
  • 成都雙流區(qū)
  • 1-3年
  • 碩士
  • 全職
  • 招1人

職位描述

Verilog HDLVHDLATE測(cè)試平臺(tái)開發(fā)經(jīng)驗(yàn)電子/半導(dǎo)體/集成電路
一、崗位職責(zé)
1. 負(fù)責(zé)芯片測(cè)試相關(guān)FPGA平臺(tái)搭建,用Verilog/VHDL編寫測(cè)試邏輯、生成測(cè)試向量,支撐芯片功能/性能測(cè)試驗(yàn)證;
2. 配合芯片測(cè)試工程師設(shè)計(jì)測(cè)試方案,優(yōu)化FPGA測(cè)試電路與時(shí)序,解決測(cè)試過程中FPGA與待測(cè)芯片的接口適配問題;
3. (如有硬件/算法基礎(chǔ))協(xié)助設(shè)計(jì)芯片測(cè)試硬件電路,或優(yōu)化測(cè)試算法(如信號(hào)采集、數(shù)據(jù)比對(duì)算法),提升測(cè)試效率;
4. 編寫FPGA測(cè)試平臺(tái)設(shè)計(jì)文檔、測(cè)試報(bào)告,配合團(tuán)隊(duì)完成芯片測(cè)試階段的項(xiàng)目交付。
二、任職要求
1. 碩士及以上學(xué)歷,電子信息工程、通信工程、信號(hào)與信息處理、微電子等相關(guān)專業(yè);
2. 具備2年以上FPGA設(shè)計(jì)經(jīng)驗(yàn),有芯片測(cè)試(數(shù)字/模擬芯片均可)、ATE測(cè)試平臺(tái)開發(fā)經(jīng)驗(yàn)者優(yōu)先;
3. 熟練掌握Verilog/VHDL硬件描述語言,精通Vivado/Modelsim等工具,能獨(dú)立完成FPGA測(cè)試邏輯設(shè)計(jì)與時(shí)序優(yōu)化;
4. 了解芯片測(cè)試基本流程,熟悉FPGA與待測(cè)芯片(如MCU、ADC/DAC、邏輯芯片)的接口設(shè)計(jì),具備硬件設(shè)計(jì)或測(cè)試算法基礎(chǔ)者優(yōu)先;
5. 具備較強(qiáng)的問題排查能力,能配合芯片測(cè)試團(tuán)隊(duì)高效協(xié)作,適應(yīng)芯片測(cè)試階段的項(xiàng)目節(jié)奏。

工作地點(diǎn)

雙流區(qū)成都華微電子科技有限公司(總部)

職位發(fā)布者

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公司Logo成都華微電子科技股份有限公司
公司位于成都市高新區(qū)益州大道中段1800號(hào)天府軟件園G1號(hào)樓,辦公場(chǎng)地近3500平方米,國家“909”工程建設(shè)項(xiàng)目之一,成立于2000年3月,注冊(cè)資金1.9億元。公司以芯片設(shè)計(jì)為主,輔以電子應(yīng)用產(chǎn)品開發(fā)、技術(shù)服務(wù)。以“誠信、和諧、拼搏、創(chuàng)新”為企業(yè)理念,以“容納百川的胸懷,堅(jiān)韌不拔的意志。與人為善的品質(zhì),追求卓越的精神”為企業(yè)精神,以“聚集英才、把握市場(chǎng)、挑戰(zhàn)技術(shù)、創(chuàng)造未來”為發(fā)展戰(zhàn)略,以“建設(shè)國內(nèi)一流集成電路設(shè)計(jì)公司、共創(chuàng)信息社會(huì)美好明天”為企業(yè)宗旨。公司具備90納米CMOS、0.18微米Bi-cmos及BCD先進(jìn)制程的數(shù)字模擬混合信號(hào)設(shè)計(jì)技術(shù),可編程邏輯器件、A/D、D/A、模擬電路及接口電路的系列產(chǎn)品方面在國內(nèi)具有優(yōu)勢(shì)??删幊踢壿嬈骷﨏PLD、FPGA硬件設(shè)計(jì)平臺(tái)、可編程邏輯器件綜合、映射及編程算法軟件技術(shù)平臺(tái)、可嵌入MCU、DSP、DLL、I/O等SOPC設(shè)計(jì)技術(shù)、△-∑、流水線、逐次逼近等A/D、D/A設(shè)計(jì)技術(shù)、PCI、VME、1394等設(shè)計(jì)技術(shù)、高頻數(shù)字輸出LVDS設(shè)計(jì)技術(shù)、CMOS高精度帶隙基準(zhǔn)設(shè)計(jì)技術(shù)、PWM、PFM設(shè)計(jì)技術(shù)、高可靠抗ESD、EMI、Environment設(shè)計(jì)技術(shù)、故障診斷及掃描測(cè)試技術(shù)。
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