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?1、 參與項(xiàng)目/產(chǎn)品方案評(píng)審，負(fù)責(zé) FPGA 資源評(píng)估和軟硬件架構(gòu)設(shè)
計(jì)。
2、 負(fù)責(zé) FPGA 代碼設(shè)計(jì)、仿真實(shí)現(xiàn)和功能調(diào)試。
3、 負(fù)責(zé)硬件接口代碼設(shè)計(jì)。
4、 負(fù)責(zé)項(xiàng)目技術(shù)文檔的編寫。

?1、 碩士研究生，電子、通信、 微電子相關(guān)專業(yè)，2年及以上同崗位經(jīng)驗(yàn)；2、 熟悉 VHDL/Verilog 語言，能獨(dú)立進(jìn)行 FPGA 時(shí)序設(shè)計(jì)/分析/仿
真；
3、 熟練使用 FPGA 開發(fā)工具和平臺(tái)，了解 FPGA 架構(gòu)和特性，有國
產(chǎn)化開發(fā)經(jīng)驗(yàn)的優(yōu)先；
4、具有較強(qiáng)的問題分析和解決能力；
5、 具備良好的抗壓能力，能夠適應(yīng)長期的高壓工作環(huán)境（ 加班、
出差等）。

山東-青島-城陽區(qū)-西元莊-