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一、崗位職責(zé)
1.參與新產(chǎn)品討論，溝通新產(chǎn)品開發(fā)方案，主導(dǎo)FPGA設(shè)計和開發(fā)工作；
2.從事基于FPGA的實時數(shù)據(jù)處理系統(tǒng)開發(fā)：數(shù)據(jù)采集高速AD/DA、SPI、I2C外設(shè)、PCIe高速接口、GTX高速串行接口等外設(shè)接口調(diào)試與驗證：
3.實時數(shù)據(jù)處理系統(tǒng)方案設(shè)計，P設(shè)計，P驗證：數(shù)據(jù)采集積分、濾波、特征提取等功能P的設(shè)計、實現(xiàn)、驗證；
4根據(jù)文檔規(guī)范要求撰寫全部或者部分開發(fā)文檔：系統(tǒng)方案、P設(shè)計方案、調(diào)試報告等。
5.負責(zé)研發(fā)項目FPGA模塊的整體規(guī)劃與實施工作，制定任務(wù)計劃，帶領(lǐng)團隊成員完成開發(fā)任務(wù)，確保項目按時按質(zhì)完成。
6.針對研發(fā)過程中遇到的技術(shù)難點和關(guān)鍵問題，組織或參與技術(shù)攻關(guān)，提供解決方案。
7指導(dǎo)FPGA工程師和新團隊成員的工作，提升團隊整體技術(shù)水平和工作效率。通過培訓(xùn)和分享經(jīng)驗，促進團隊成員的成長和發(fā)展。
二、任職要求
1.碩士及以上學(xué)歷，電子科學(xué)與技術(shù)、微電子學(xué)等相關(guān)專業(yè)；
2.5年及以上FPGA設(shè)計開發(fā)經(jīng)驗，熟練掌握固件架構(gòu)設(shè)計、方案系統(tǒng)設(shè)計，熟悉FPGA原理、了解FPGA資源組成；
3.熟悉Verilog開發(fā)語言，熟悉時序約束條件；熟悉能譜分析、頻譜分析算法者優(yōu)先；
4.具有高端制造業(yè)研發(fā)技術(shù)經(jīng)驗，數(shù)據(jù)采集、儀器儀表等行業(yè)經(jīng)驗考慮；
5.具備良好的抗壓、溝通能力、項目管理能力。
三、福利待遇
1、六險一金，單邊12%公積金比例：
2、早九晚六，周末雙休；
3、豐富的福利補貼，包括但不限于節(jié)日禮金、體檢、生日福利等
公司及產(chǎn)品情況可登錄以下網(wǎng)址查詢：https://www.ustcholding.com/2023/0302
/c33919a593725/page.htm
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