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崗位職責(zé)：
1. 系統(tǒng)設(shè)計與方案論證： 參與項目需求分析，主導(dǎo)高速信號處理板卡的架構(gòu)設(shè)計、芯片選型（如FPGA、DSP、CPU、ADC/DAC、SerDes PHY等）和技術(shù)方案制定。
2. 高速電路設(shè)計與仿真： ·
負(fù)責(zé)高速數(shù)字電路（如DDR4/5, PCIe Gen4/5, JESD204B/C, 10G+以太網(wǎng)等）的原理圖設(shè)計。 ·
運(yùn)用EDA工具（如Cadence Allegro, SIwave,
HyperLynx）進(jìn)行信號完整性（SI）、電源完整性（PI）及電磁兼容性（EMC）的仿真分析與優(yōu)化，確保設(shè)計一次成功。
3. 高密度PCB設(shè)計指導(dǎo)：
指導(dǎo)或親自進(jìn)行多層（通常12層以上）、高密度互連（HDI）PCB的布局布線，制定嚴(yán)格的布線約束規(guī)則，解決高速、高功耗、高密度帶來的挑戰(zhàn)。
4. 板卡調(diào)試與測試驗證： 獨(dú)立搭建測試環(huán)境，使用高端示波器、矢量網(wǎng)絡(luò)分析儀（VNA）、邏輯分析儀等設(shè)備進(jìn)行板級調(diào)試、性能測試和故障定位，確保產(chǎn)品性能達(dá)標(biāo)。
5. 技術(shù)文檔編寫： 撰寫詳細(xì)的設(shè)計文檔、測試報告和生產(chǎn)指導(dǎo)文件，為后續(xù)的批量生產(chǎn)和維護(hù)提供堅實支撐。
6. 技術(shù)攻關(guān)與前沿追蹤： 跟蹤行業(yè)最新技術(shù)動態(tài)，解決研發(fā)過程中的關(guān)鍵技術(shù)難題，持續(xù)提升產(chǎn)品競爭力。
任職要求：
1. 學(xué)歷與專業(yè)： 電子工程、微波工程、通信工程等相關(guān)專業(yè)本科及以上學(xué)歷，3年以上高速數(shù)字電路硬件開發(fā)經(jīng)驗。
2. 深厚的技術(shù)功底： ·
精通高速信號完整性理論： 深刻理解傳輸線理論、阻抗匹配、抖動、眼圖等關(guān)鍵概念。 ·
豐富的實戰(zhàn)經(jīng)驗： 擁有至少3個及以上成功量產(chǎn)的、涉及高速接口（如PCIe,
DDR, SerDes, 高速ADC/DAC接口）的板卡設(shè)計項目經(jīng)驗，并能詳細(xì)闡述您在SI/PI仿真和問題解決中的貢獻(xiàn)。 ·
熟練使用EDA工具： 精通Cadence/Allegro或同等級別原理圖和PCB設(shè)計工具；熟練掌握一種以上SI/PI仿真工具。 ·
出色的調(diào)試能力： 能熟練使用高端測試儀器進(jìn)行信號測量和故障分析，動手能力強(qiáng)。
3. 核心素質(zhì)： 具備極強(qiáng)的責(zé)任心、嚴(yán)謹(jǐn)?shù)倪壿嬎季S、出色的分析問題和解決問題的能力，以及良好的團(tuán)隊協(xié)作精神。
優(yōu)先考慮：
l 有JG項目經(jīng)驗者優(yōu)先
l 擁有DSP、FPGA（Xilinx/Intel）周邊高速電路設(shè)計經(jīng)驗者。
l 有射頻/微波電路設(shè)計或數(shù)?；旌想娐吩O(shè)計經(jīng)驗者。
l 熟悉相關(guān)行業(yè)標(biāo)準(zhǔn)（如VITA, OpenVPX等）及JG/航空航天設(shè)計規(guī)范者。
在信號處理、圖像處理或數(shù)據(jù)采集領(lǐng)域有系統(tǒng)級項目經(jīng)驗者。