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崗位職責
SerDes IP的架構定義與技術選型；高速SerDes的模擬/數(shù)字模塊（如PLL、CDR、TX/RX均衡器）方案，原理圖設計、仿真及版圖設計；封裝、單板及系統(tǒng)級設計，信號完整性（SI/PI）設計等，
任職要求
1、8年以上高速SerDes設計經(jīng)驗；
2、精通PLL、CDR、CTLE、ADC/DSP等SerDes關鍵模塊設計，熟悉FinFET先進工藝。
3、熟練使用Virtuoso、ADS、Hspice/Spectre等工具；
4、有56G/112G及以上速率項目經(jīng)驗者優(yōu)先；
5、有國內(nèi)外知名廠商SerDes設計、成功投片/量產(chǎn)工作經(jīng)驗優(yōu)先。