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1. 核心技能要求
- 精通Verilog/VHDL硬件描述語言，具備MIPI CSI/DSI協(xié)議FPGA驅(qū)動開發(fā)經(jīng)驗(yàn)，能獨(dú)立完成多路攝像頭、LCOS屏的MIPI接口邏輯設(shè)計(jì)與調(diào)試。
- 熟悉FPGA內(nèi)部資源（時鐘管理、FIFO、DMA、GPIO）的配置與優(yōu)化，掌握視頻圖像處理相關(guān)邏輯設(shè)計(jì)（如幀同步、視頻合成、分屏顯示）。
- 具備FPGA與ARM異構(gòu)系統(tǒng)開發(fā)經(jīng)驗(yàn)，能實(shí)現(xiàn)兩者間的數(shù)據(jù)交互（如通過AXI總線、SPI/I2C），支撐雙屏驅(qū)動與視頻流傳輸方案落地。
- 熟練使用主流FPGA開發(fā)工具（如Vivado、Quartus），掌握邏輯仿真（ModelSim）、時序分析與約束編寫，能定位并解決時序違例、信號完整性等問題。
2. 硬件能力要求
- 能配合完成FPGA核心板硬件電路設(shè)計(jì)，熟悉高速信號（MIPI、LVDS）布線規(guī)則，具備硬件調(diào)試能力，可使用示波器、邏輯分析儀排查接口通信故障。
- 了解攝像頭、LCOS屏的硬件特性與寄存器配置，能根據(jù)器件規(guī)格書完成FPGA驅(qū)動的寄存器初始化序列編寫。
3. 項(xiàng)目經(jīng)驗(yàn)要求
- 有多路視頻輸入輸出FPGA項(xiàng)目經(jīng)驗(yàn)優(yōu)先，例如雙攝像頭數(shù)據(jù)采集、雙屏同步顯示相關(guān)開發(fā)經(jīng)歷。
- 具備嵌入式視覺類項(xiàng)目（如機(jī)器視覺、便攜顯示設(shè)備）開發(fā)經(jīng)驗(yàn)者優(yōu)先。
第一點(diǎn)是必須滿足項(xiàng)